blob: 45e390debb3ab805c7aa91ad314ba007c93d53a3 [file] [log] [blame]
Stefan Roeseae9996c2015-11-18 11:06:09 +01001/*
2 * Altera SoCFPGA PinMux configuration
3 *
4 * SPDX-License-Identifier: BSD-3-Clause
5 */
6
7#ifndef __SOCFPGA_PINMUX_CONFIG_H__
8#define __SOCFPGA_PINMUX_CONFIG_H__
9
10const u8 sys_mgr_init_table[] = {
11 0, /* EMACIO0 */
12 2, /* EMACIO1 */
13 2, /* EMACIO2 */
14 2, /* EMACIO3 */
15 2, /* EMACIO4 */
16 2, /* EMACIO5 */
17 2, /* EMACIO6 */
18 2, /* EMACIO7 */
19 2, /* EMACIO8 */
20 0, /* EMACIO9 */
21 2, /* EMACIO10 */
22 2, /* EMACIO11 */
23 2, /* EMACIO12 */
24 2, /* EMACIO13 */
25 0, /* EMACIO14 */
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27 0, /* EMACIO16 */
28 0, /* EMACIO17 */
29 0, /* EMACIO18 */
30 0, /* EMACIO19 */
31 3, /* FLASHIO0 */
32 0, /* FLASHIO1 */
33 3, /* FLASHIO2 */
34 3, /* FLASHIO3 */
35 0, /* FLASHIO4 */
36 0, /* FLASHIO5 */
37 0, /* FLASHIO6 */
38 0, /* FLASHIO7 */
39 0, /* FLASHIO8 */
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43 0, /* GENERALIO0 */
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133 1, /* GPLMUX5 */
134 1, /* GPLMUX6 */
135 1, /* GPLMUX7 */
136 1, /* GPLMUX8 */
137 0, /* GPLMUX9 */
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151 1, /* GPLMUX23 */
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159 1, /* GPLMUX31 */
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161 1, /* GPLMUX33 */
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192 1, /* GPLMUX64 */
193 1, /* GPLMUX65 */
194 1, /* GPLMUX66 */
195 1, /* GPLMUX67 */
196 1, /* GPLMUX68 */
197 1, /* GPLMUX69 */
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206 0, /* QSPIUSEFPGA */
207 0, /* SPIS1USEFPGA */
208 0, /* RGMII0USEFPGA */
209 0, /* UART1USEFPGA */
210 0, /* CAN1USEFPGA */
211 0, /* USB1USEFPGA */
212 0, /* I2C3USEFPGA */
213 0, /* I2C2USEFPGA */
214 0, /* I2C1USEFPGA */
215 0, /* SPIM1USEFPGA */
216 0, /* USB0USEFPGA */
217 0 /* SPIM0USEFPGA */
218};
219#endif /* __SOCFPGA_PINMUX_CONFIG_H__ */