Blame - board/overo/overo.h - platform/external/u-boot

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				2	* (C) Copyright 2008
				3	* Steve Sakoman <steve@sakoman.com>
				4	*
Wolfgang Denk	1a45966	2013-07-08 09:37:19 +0200	[diff] [blame]	5	* SPDX-License-Identifier: GPL-2.0+
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				7	#ifndef _OVERO_H_
				8	#define _OVERO_H_
				9
				10	const omap3_sysinfo sysinfo = {
Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	11	DDR_STACKED,
Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	12	"Gumstix Overo board",
				13	#if defined(CONFIG_ENV_IS_IN_ONENAND)
				14	"OneNAND",
				15	#else
				16	"NAND",
				17	#endif
				18	};
				19
Andreas Müller	137703b	2012-01-04 15:26:25 +0000	[diff] [blame]	20	/* overo revisions */
				21	#define REVISION_0 0x0
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				23	#define REVISION_2 0x2
Steve Sakoman	49720a4	2013-07-24 12:22:34 -0700	[diff] [blame]	24	#define REVISION_3 0x3
Ash Charles	be4cc45	2014-05-21 14:04:52 -0700	[diff] [blame]	25	#define REVISION_4 0x4
Andreas Müller	137703b	2012-01-04 15:26:25 +0000	[diff] [blame]	26
Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	27	/*
				28	* IEN - Input Enable
				29	* IDIS - Input Disable
				30	* PTD - Pull type Down
				31	* PTU - Pull type Up
				32	* DIS - Pull type selection is inactive
				33	* EN - Pull type selection is active
				34	* M0 - Mode 0
				35	* The commented string gives the final mux configuration for that pin
				36	*/
				37	#define MUX_OVERO() \
				38	/SDRC/\
Olof Johansson	fc9165f	2009-09-28 08:19:30 -0400	[diff] [blame]	39	MUX_VAL(CP(SDRC_D0), (IEN \| PTD \| DIS \| M0)) /SDRC_D0/\
				40	MUX_VAL(CP(SDRC_D1), (IEN \| PTD \| DIS \| M0)) /SDRC_D1/\
				41	MUX_VAL(CP(SDRC_D2), (IEN \| PTD \| DIS \| M0)) /SDRC_D2/\
				42	MUX_VAL(CP(SDRC_D3), (IEN \| PTD \| DIS \| M0)) /SDRC_D3/\
				43	MUX_VAL(CP(SDRC_D4), (IEN \| PTD \| DIS \| M0)) /SDRC_D4/\
				44	MUX_VAL(CP(SDRC_D5), (IEN \| PTD \| DIS \| M0)) /SDRC_D5/\
				45	MUX_VAL(CP(SDRC_D6), (IEN \| PTD \| DIS \| M0)) /SDRC_D6/\
				46	MUX_VAL(CP(SDRC_D7), (IEN \| PTD \| DIS \| M0)) /SDRC_D7/\
				47	MUX_VAL(CP(SDRC_D8), (IEN \| PTD \| DIS \| M0)) /SDRC_D8/\
				48	MUX_VAL(CP(SDRC_D9), (IEN \| PTD \| DIS \| M0)) /SDRC_D9/\
				49	MUX_VAL(CP(SDRC_D10), (IEN \| PTD \| DIS \| M0)) /SDRC_D10/\
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				51	MUX_VAL(CP(SDRC_D12), (IEN \| PTD \| DIS \| M0)) /SDRC_D12/\
				52	MUX_VAL(CP(SDRC_D13), (IEN \| PTD \| DIS \| M0)) /SDRC_D13/\
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				102	MUX_VAL(CP(GPMC_D15), (IEN \| PTU \| EN \| M0)) /GPMC_D15/\
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				107	/* - MMC1_WP*/\
				108	MUX_VAL(CP(GPMC_NCS4), (IDIS \| PTU \| EN \| M0)) /GPMC_nCS4/\
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				177	/* - PEN_DOWN*/\
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				202	MUX_VAL(CP(MMC2_DAT4), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT0/\
				203	MUX_VAL(CP(MMC2_DAT5), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT1/\
				204	MUX_VAL(CP(MMC2_DAT6), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_CMD/\
Steve Sakoman	a06e162	2010-08-24 10:37:29 -0700	[diff] [blame]	205	MUX_VAL(CP(MMC2_DAT7), (IEN \| PTU \| EN \| M4)) /GPIO_139/\
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				214	MUX_VAL(CP(UART2_RX), (IEN \| PTD \| DIS \| M4)) /GPIO_147/\
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				216	MUX_VAL(CP(UART1_RTS), (IEN \| PTU \| DIS \| M4)) /GPIO_149/ \
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				229	MUX_VAL(CP(MCBSP1_CLKX), (IEN \| PTD \| DIS \| M0)) /McBSP1_CLKX/\
Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	230	/Serial Interface/\
Olof Johansson	fc9165f	2009-09-28 08:19:30 -0400	[diff] [blame]	231	MUX_VAL(CP(UART3_CTS_RCTX), (IEN \| PTD \| EN \| M0)) /UART3_CTS_RCTX/\
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				265	/* - LAN_INTR */\
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Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	272	/Control and debug /\
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Steve Sakoman	9314961	2010-02-16 10:00:45 -0800	[diff] [blame]	286	MUX_VAL(CP(ETK_CLK_ES2), (IEN \| PTU \| EN \| M2)) /MMC3_CLK/\
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Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	305	/* die to die */\
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Dirk Behme	9d0fc81	2009-01-28 21:39:57 +0100	[diff] [blame]	371
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				387
				388	#define MUX_OVERO_SDIO2_TRANSCEIVER() \
				389	MUX_VAL(CP(MMC2_CLK), (IEN \| PTU \| EN \| M0)) /MMC2_CLK/\
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				393	MUX_VAL(CP(MMC2_DAT2), (IEN \| PTU \| EN \| M0)) /MMC2_DAT2/\
				394	MUX_VAL(CP(MMC2_DAT3), (IEN \| PTU \| EN \| M0)) /MMC2_DAT3/\
				395	MUX_VAL(CP(MMC2_DAT4), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT0/\
				396	MUX_VAL(CP(MMC2_DAT5), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT1/\
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Ash Charles	ea5940e	2014-05-21 14:04:53 -0700	[diff] [blame]	408	#define MUX_ALTO35() \
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				423
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